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Considere agora um trecho de uma memória cache interligada à memória principal apresentada. Cada linha abriga um bloco de memória com duas células. No exemplo ilustrado a seguir, a linha 220 armazena o bloco que contém as células de endereços FF8 e FF9.
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Considerando-se esse cenário, tem-se que a memória cache implementa a 
A
política de escrita conhecida como escrita somente no retorno (write back). 
B
política de escrita conhecida como escrita uma vez (write once). 
C
política de mapeamento de escrita em blocos conhecida por LFU (least frequently used). 
D
técnica de mapeamento de blocos da memória principal conhecida como mapeamento direto. 
E
técnica de mapeamento de blocos da memória principal conhecida como mapeamento associativo.
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O número máximo de células que essa memória pode conter será igual a 
A
512 
B
1024 
C
2048 
D
4096 
E
8192
O relógio de um processador consiste em um dispositivo que tem como finalidade sincronizar e cadenciar (controlar a velocidade) as ações executadas por essa unidade. Em cada ciclo (intervalo de tempo entre o início da subida/ descida de um pulso até o início de sua descida/subida), uma ação é realizada pelo processador.

Se o intervalo de tempo entre duas ações consecutivas de um processador é igual a 2 nanossegundos, qual será a sua frequência em Gigahertz (GHz)? 
A
0,25 
B
0,50 
C
1,00 
D
1,50 
E
2,00
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